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Enumerations
reg_map.h File Reference

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Enumerations

enum  reg_scope_instances {
  regi_ccd = 0xb0000000, regi_ccd_top = 0xb0000000, regi_ccd_dp = 0xb0000400, regi_ccd_stat = 0xb0000800,
  regi_ccd_tg = 0xb0001000, regi_cfg = 0xb0002000, regi_clkgen = 0xb0004000, regi_ddr2_ctrl = 0xb0006000,
  regi_dma0 = 0xb0008000, regi_dma1 = 0xb000a000, regi_dma11 = 0xb000c000, regi_dma2 = 0xb000e000,
  regi_dma3 = 0xb0010000, regi_dma4 = 0xb0012000, regi_dma5 = 0xb0014000, regi_dma6 = 0xb0016000,
  regi_dma7 = 0xb0018000, regi_dma9 = 0xb001a000, regi_eth = 0xb001c000, regi_gio = 0xb0020000,
  regi_h264 = 0xb0022000, regi_hist = 0xb0026000, regi_iop = 0xb0028000, regi_iop_version = 0xb0028000,
  regi_iop_fifo_in_extra = 0xb0028040, regi_iop_fifo_out_extra = 0xb0028080, regi_iop_trigger_grp0 = 0xb00280c0, regi_iop_trigger_grp1 = 0xb0028100,
  regi_iop_trigger_grp2 = 0xb0028140, regi_iop_trigger_grp3 = 0xb0028180, regi_iop_trigger_grp4 = 0xb00281c0, regi_iop_trigger_grp5 = 0xb0028200,
  regi_iop_trigger_grp6 = 0xb0028240, regi_iop_trigger_grp7 = 0xb0028280, regi_iop_crc_par = 0xb0028300, regi_iop_dmc_in = 0xb0028380,
  regi_iop_dmc_out = 0xb0028400, regi_iop_fifo_in = 0xb0028480, regi_iop_fifo_out = 0xb0028500, regi_iop_scrc_in = 0xb0028580,
  regi_iop_scrc_out = 0xb0028600, regi_iop_timer_grp0 = 0xb0028680, regi_iop_timer_grp1 = 0xb0028700, regi_iop_sap_in = 0xb0028800,
  regi_iop_sap_out = 0xb0028900, regi_iop_spu = 0xb0028a00, regi_iop_sw_cfg = 0xb0028b00, regi_iop_sw_cpu = 0xb0028c00,
  regi_iop_sw_mpu = 0xb0028d00, regi_iop_sw_spu = 0xb0028e00, regi_iop_mpu = 0xb0029000, regi_irq = 0xb002a000,
  regi_irq2 = 0xb006a000, regi_jpeg = 0xb002c000, regi_l2cache = 0xb0030000, regi_marb_bar = 0xb0032000,
  regi_marb_bar_bp0 = 0xb0032140, regi_marb_bar_bp1 = 0xb0032180, regi_marb_bar_bp2 = 0xb00321c0, regi_marb_bar_bp3 = 0xb0032200,
  regi_marb_foo = 0xb0034000, regi_marb_foo_bp0 = 0xb0034280, regi_marb_foo_bp1 = 0xb00342c0, regi_marb_foo_bp2 = 0xb0034300,
  regi_marb_foo_bp3 = 0xb0034340, regi_pinmux = 0xb0038000, regi_pio = 0xb0036000, regi_sclr = 0xb003a000,
  regi_sclr_fifo = 0xb003c000, regi_ser0 = 0xb003e000, regi_ser1 = 0xb0040000, regi_ser2 = 0xb0042000,
  regi_ser3 = 0xb0044000, regi_ser4 = 0xb0046000, regi_sser = 0xb0048000, regi_strcop = 0xb004a000,
  regi_strdma0 = 0xb004e000, regi_strdma1 = 0xb0050000, regi_strdma2 = 0xb0052000, regi_strdma3 = 0xb0054000,
  regi_strdma5 = 0xb0056000, regi_strmux = 0xb004c000, regi_timer0 = 0xb0058000, regi_timer1 = 0xb005a000,
  regi_timer2 = 0xb006e000, regi_trace = 0xb005c000, regi_vin = 0xb005e000, regi_vout = 0xb0060000,
  regi_ata = 0xb0032000, regi_bif_core = 0xb0014000, regi_bif_dma = 0xb0016000, regi_bif_slave = 0xb0018000,
  regi_config = 0xb003c000, regi_dma0 = 0xb0000000, regi_dma1 = 0xb0002000, regi_dma2 = 0xb0004000,
  regi_dma3 = 0xb0006000, regi_dma4 = 0xb0008000, regi_dma5 = 0xb000a000, regi_dma6 = 0xb000c000,
  regi_dma7 = 0xb000e000, regi_dma8 = 0xb0010000, regi_dma9 = 0xb0012000, regi_eth0 = 0xb0034000,
  regi_eth1 = 0xb0036000, regi_gio = 0xb001a000, regi_iop = 0xb0020000, regi_iop_version = 0xb0020000,
  regi_iop_fifo_in0_extra = 0xb0020040, regi_iop_fifo_in1_extra = 0xb0020080, regi_iop_fifo_out0_extra = 0xb00200c0, regi_iop_fifo_out1_extra = 0xb0020100,
  regi_iop_trigger_grp0 = 0xb0020140, regi_iop_trigger_grp1 = 0xb0020180, regi_iop_trigger_grp2 = 0xb00201c0, regi_iop_trigger_grp3 = 0xb0020200,
  regi_iop_trigger_grp4 = 0xb0020240, regi_iop_trigger_grp5 = 0xb0020280, regi_iop_trigger_grp6 = 0xb00202c0, regi_iop_trigger_grp7 = 0xb0020300,
  regi_iop_crc_par0 = 0xb0020380, regi_iop_crc_par1 = 0xb0020400, regi_iop_dmc_in0 = 0xb0020480, regi_iop_dmc_in1 = 0xb0020500,
  regi_iop_dmc_out0 = 0xb0020580, regi_iop_dmc_out1 = 0xb0020600, regi_iop_fifo_in0 = 0xb0020680, regi_iop_fifo_in1 = 0xb0020700,
  regi_iop_fifo_out0 = 0xb0020780, regi_iop_fifo_out1 = 0xb0020800, regi_iop_scrc_in0 = 0xb0020880, regi_iop_scrc_in1 = 0xb0020900,
  regi_iop_scrc_out0 = 0xb0020980, regi_iop_scrc_out1 = 0xb0020a00, regi_iop_timer_grp0 = 0xb0020a80, regi_iop_timer_grp1 = 0xb0020b00,
  regi_iop_timer_grp2 = 0xb0020b80, regi_iop_timer_grp3 = 0xb0020c00, regi_iop_sap_in = 0xb0020d00, regi_iop_sap_out = 0xb0020e00,
  regi_iop_spu0 = 0xb0020f00, regi_iop_spu1 = 0xb0021000, regi_iop_sw_cfg = 0xb0021100, regi_iop_sw_cpu = 0xb0021200,
  regi_iop_sw_mpu = 0xb0021300, regi_iop_sw_spu0 = 0xb0021400, regi_iop_sw_spu1 = 0xb0021500, regi_iop_mpu = 0xb0021600,
  regi_irq = 0xb001c000, regi_irq2 = 0xb005c000, regi_marb = 0xb003e000, regi_marb_bp0 = 0xb003e240,
  regi_marb_bp1 = 0xb003e280, regi_marb_bp2 = 0xb003e2c0, regi_marb_bp3 = 0xb003e300, regi_pinmux = 0xb0038000,
  regi_ser0 = 0xb0026000, regi_ser1 = 0xb0028000, regi_ser2 = 0xb002a000, regi_ser3 = 0xb002c000,
  regi_sser0 = 0xb0022000, regi_sser1 = 0xb0024000, regi_strcop = 0xb0030000, regi_strmux = 0xb003a000,
  regi_timer = 0xb001e000, regi_timer0 = 0xb001e000, regi_timer2 = 0xb005e000, regi_trace = 0xb0040000
}
 

Enumeration Type Documentation

Enumerator:
regi_ccd 
regi_ccd_top 
regi_ccd_dp 
regi_ccd_stat 
regi_ccd_tg 
regi_cfg 
regi_clkgen 
regi_ddr2_ctrl 
regi_dma0 
regi_dma1 
regi_dma11 
regi_dma2 
regi_dma3 
regi_dma4 
regi_dma5 
regi_dma6 
regi_dma7 
regi_dma9 
regi_eth 
regi_gio 
regi_h264 
regi_hist 
regi_iop 
regi_iop_version 
regi_iop_fifo_in_extra 
regi_iop_fifo_out_extra 
regi_iop_trigger_grp0 
regi_iop_trigger_grp1 
regi_iop_trigger_grp2 
regi_iop_trigger_grp3 
regi_iop_trigger_grp4 
regi_iop_trigger_grp5 
regi_iop_trigger_grp6 
regi_iop_trigger_grp7 
regi_iop_crc_par 
regi_iop_dmc_in 
regi_iop_dmc_out 
regi_iop_fifo_in 
regi_iop_fifo_out 
regi_iop_scrc_in 
regi_iop_scrc_out 
regi_iop_timer_grp0 
regi_iop_timer_grp1 
regi_iop_sap_in 
regi_iop_sap_out 
regi_iop_spu 
regi_iop_sw_cfg 
regi_iop_sw_cpu 
regi_iop_sw_mpu 
regi_iop_sw_spu 
regi_iop_mpu 
regi_irq 
regi_irq2 
regi_jpeg 
regi_l2cache 
regi_marb_bar 
regi_marb_bar_bp0 
regi_marb_bar_bp1 
regi_marb_bar_bp2 
regi_marb_bar_bp3 
regi_marb_foo 
regi_marb_foo_bp0 
regi_marb_foo_bp1 
regi_marb_foo_bp2 
regi_marb_foo_bp3 
regi_pinmux 
regi_pio 
regi_sclr 
regi_sclr_fifo 
regi_ser0 
regi_ser1 
regi_ser2 
regi_ser3 
regi_ser4 
regi_sser 
regi_strcop 
regi_strdma0 
regi_strdma1 
regi_strdma2 
regi_strdma3 
regi_strdma5 
regi_strmux 
regi_timer0 
regi_timer1 
regi_timer2 
regi_trace 
regi_vin 
regi_vout 
regi_ata 
regi_bif_core 
regi_bif_dma 
regi_bif_slave 
regi_config 
regi_dma0 
regi_dma1 
regi_dma2 
regi_dma3 
regi_dma4 
regi_dma5 
regi_dma6 
regi_dma7 
regi_dma8 
regi_dma9 
regi_eth0 
regi_eth1 
regi_gio 
regi_iop 
regi_iop_version 
regi_iop_fifo_in0_extra 
regi_iop_fifo_in1_extra 
regi_iop_fifo_out0_extra 
regi_iop_fifo_out1_extra 
regi_iop_trigger_grp0 
regi_iop_trigger_grp1 
regi_iop_trigger_grp2 
regi_iop_trigger_grp3 
regi_iop_trigger_grp4 
regi_iop_trigger_grp5 
regi_iop_trigger_grp6 
regi_iop_trigger_grp7 
regi_iop_crc_par0 
regi_iop_crc_par1 
regi_iop_dmc_in0 
regi_iop_dmc_in1 
regi_iop_dmc_out0 
regi_iop_dmc_out1 
regi_iop_fifo_in0 
regi_iop_fifo_in1 
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regi_iop_fifo_out1 
regi_iop_scrc_in0 
regi_iop_scrc_in1 
regi_iop_scrc_out0 
regi_iop_scrc_out1 
regi_iop_timer_grp0 
regi_iop_timer_grp1 
regi_iop_timer_grp2 
regi_iop_timer_grp3 
regi_iop_sap_in 
regi_iop_sap_out 
regi_iop_spu0 
regi_iop_spu1 
regi_iop_sw_cfg 
regi_iop_sw_cpu 
regi_iop_sw_mpu 
regi_iop_sw_spu0 
regi_iop_sw_spu1 
regi_iop_mpu 
regi_irq 
regi_irq2 
regi_marb 
regi_marb_bp0 
regi_marb_bp1 
regi_marb_bp2 
regi_marb_bp3 
regi_pinmux 
regi_ser0 
regi_ser1 
regi_ser2 
regi_ser3 
regi_sser0 
regi_sser1 
regi_strcop 
regi_strmux 
regi_timer 
regi_timer0 
regi_timer2 
regi_trace 

Definition at line 22 of file reg_map.h.